ChristofR
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Erstellt: 19.05.05, 00:07 Betreff: Re: Fehler bei Signal Synthese |
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Hi wittekes,
das VHDL Modell für den DCF Empfänger ist jetzt bald fertig. hast du noch interesse daran ?
gibts eigentlich einen CPLD mit so Größenordnung 160 Makrozellen zum noch von "Hand" löten ?
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